防護電路之設計概念 | 合法西藥販賣商
![防護電路之設計概念](https://i.imgur.com/A2RVydN.jpg)
上專門用來做靜電放電防護之用,此靜電放電防護電路提.供了ESD電流路徑,以免ESD放電時,靜電電流流入IC內.部電路而造成損傷。人體放電模式(HBM)與機器 ...
![防護電路之設計概念](https://i.imgur.com/A2RVydN.jpg)
上專門用來做靜電放電防護之用,此靜電放電防護電路提
供了ESD電流路徑,以免ESD放電時,靜電電流流入IC內
部電路而造成損傷。人體放電模式(HBM)與機器放電模式
(MM)之ESD來自外界,所以ESD防護電路都是做在銲墊
PAD的旁邊。在輸出PAD,其輸出級大尺寸的PMOS及
NMOS元件本身便可當做ESD防謢元件來用,但是其佈局
方式必須遵守Design Rules中有關ESD佈局方面的規定。在
輸入PAD,因CMOS積體電路的輸入PAD一般都是連接到
MOS元件的閘極(gate),閘極氧化層是容易被ESD所打穿,
因此在輸入墊的旁邊會做一組ESD防護電路來保護輸入級
的元件。在VDD pad與VSS pad的旁邊也要做ESD防護電路
,因為VDD與VSS腳之間也可能遭受ESD的放電。
ESD防護電路的安排必須全方位地考慮到ESD測試的
各種組合,因為一顆IC的ESD failure threshold是看整顆IC所
有腳中,在各種測試模式下,最低之ESD耐壓值為該顆IC
的ESD failure threshold。因此,一個全晶片ESD防護電路的
安排要如圖4.1-1所示。在圖4.1-1中,Input pad與Output pad
要具有防護PS,NS,PD,及ND四種模式的靜電放電,另
外,VDD到VSS也要有ESD防護電路。
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